ペンティアム（オリジナル）

ペンティアム（i586）
一般情報
発売1993年3月22日; 32年前 （1993年3月22日）
製造中止1999年7月15日; 26年前（注文と出荷）[1] [より良い情報源が必要] 2001年12月31日; 23年前（製造中止と寿命終了）[2] （1999年7月15日）
 （2001年12月31日）
販売元インテル
デザイン：インテル
共通メーカー
  • インテル
製品コード80501 (P5)
80502 (P54C、P54CQS、P54CS)
80503 (P55C、ティラムック)
パフォーマンス
最大CPU クロックレート60～300MHz
FSB速度50MHz～66MHz
キャッシュ
L1キャッシュ16～32 KB
L2キャッシュ最大512 KiB [3] (マザーボード上)
アーキテクチャと分類
テクノロジーノード800 nm～250 nm
マイクロアーキテクチャP5
命令セットx86-16、IA-32
拡張機能
物理的仕様
トランジスタ
コア
  • 1
ソケット
製品、モデル、バリエーション
コア名
  • P5
  • P54C
  • P54CQS
  • P54LM
  • P54CS
  • P55C
  • P55LM
  • ティラムック
  • P24T
モデル
歴史
前任者i486
後継者P6、Pentium II、Pentium III (SSE 後継)
サポート状況
サポートされていません

Pentium （ i586またはP5 Pentiumとも呼ばれる）は、1993年3月22日にIntelによって発表されたマイクロプロセッサである。これは、Pentiumブランドを使用した最初のCPUである。 [ 5 ] [ 6 ] x86（8086）互換プロセッサラインの第5世代と見なされ、 [7] i486の後継であり、その実装とマイクロアーキテクチャは社内でP5と呼ばれていた。

Intel i486と同様に、Pentiumは32ビットi386と命令セット互換性があります。i486と非常に類似したマイクロアーキテクチャを採用していますが、デュアル整数パイプライン設計と、前世代機の10倍の速度を誇るより高度な浮動小数点ユニット（FPU）を実装できるほど拡張されています。 [8]

1995年11月、Pentiumの後継としてPentium Proが発表されました。1996年10月には、オリジナルのPentiumと同じ基本的なマイクロアーキテクチャをベースに、MMX命令セット、大容量キャッシュ、その他の機能強化を加えたPentium MMX [ 9]が発表されました。Intelは、1997年のPentium II発売後、低価格帯の選択肢として販売されていたオリジナルのPentium (P5) プロセッサの製造を2001年12月31日に終了しました。これは、MicrosoftがWindows 95などの旧バージョンのWindowsのサポートを終了した時期と一致しています。Pentiumシリーズは徐々にCeleronプロセッサに置き換えられ、Celeronは80486ブランドの役割も引き継ぎました。[1] [2]

概要

P5ペンティアムは初のスーパースカラ x86プロセッサであり、2つの命令を同時に実行できることが多かった。[10]これを実装するために使用されたいくつかの技術は、以前のスーパースカラIntel i960 CA（1989）に基づいていたが、他の詳細はP5設計のために独自に発明された。また、パイプライン方式で複雑なx86エンコーディングを処理するために使用される戦略など、多くの部分がi386またはi486からコピーされた。[11] i486と同様に、ペンティアムは、特定の命令または命令の一部に応じて、最適化されたマイクロコードシステムとRISCのような技術の両方を使用していた。デュアル整数パイプライン設計は、一部の学者やRISCの競合他社によって、 CISC命令セットでは実装不可能であると主張していたものである。[誰？ ]

その他の主要な機能としては、再設計され大幅に高速化された浮動小数点演算ユニット、64ビットのバーストモード・データバス（内部および外部）、独立したコードキャッシュとデータキャッシュ、その他多くのパフォーマンス向上のための技術と機能が挙げられる。256ビットの内部データバスとライトバックキャッシュを搭載している。[12] IntelのSLアーキテクチャ以降に実装されているシステム管理モードも搭載している。[13]

66MHzペンティアムプロセッサは112 V1.1 Dhrystone MIPSで動作し、SPECint 92の評価は64.5、SPECfp 92の評価は56.9、iCOMPインデックスの評価は567です。60MHz版と66MHz版の性能差は約10%です。[14]

P5はi486と比較してマルチプロセッシングのサポートが優れており、IBMメインフレーム・コンピュータと同様のハードウェアサポートを備えた初のx86 CPUです。IntelはIBMと協力し、この機能を定義し、P5マイクロアーキテクチャに組み込みました。この機能は、以前のx86世代や競合他社のx86プロセッサには存在しませんでした。

デュアルパイプラインの性能を最大限に引き出すため、一部のコンパイラは命令レベルの並列性をより効果的に活用するように最適化されましたが、すべてのアプリケーションが再コンパイルによって大幅なメリットを得られるわけではありません。しかしながら、高速FPUはi486やi387と比較して、浮動小数点演算性能を常に大幅に向上させました。Intelは、開発ツールベンダー、ISV、オペレーティングシステム（OS）ベンダーと協力し、製品の最適化にリソースを費やしました。

Intel Pentium A80501 66 MHz SX950 ダイイメージ

競合製品としては、スーパースカラーのPowerPC 601 (1993)、SuperSPARC (1992)、DEC Alpha 21064 (1992)、AMD 29050 (1990)、Motorola MC88110 (1991)、Motorola 68060 (1994) などがあり、そのほとんどはスーパースカラーのインオーダー デュアル命令パイプライン構成を採用していました。また、スーパースカラーではないMotorola 68040 (1990) とMIPS R4000 (1991)もありました。

語源

「Pentium」という名前は、もともとギリシャ語の「5」を意味するpente ( πέντε ) に由来しており、これは Intel の 80x86 プロセッサ (8086 から 80486) の以前の数値命名規則を参照しており、その規則に従ってプロセッサが 80586 と命名されていたため、ラテン語の末尾に-iumが付けられています。

発達

P5マイクロアーキテクチャは、386と486を設計した同じサンタクララチームによって設計された。[15]設計作業は1989年6月に開始された。[16]チーム は、 RISCとCISC技術の収束となるスーパースカラRISCアーキテクチャを使用することを決定し、[17]オンチップキャッシュ、浮動小数点、分岐予測を備えた。[18]当時のマイクロプロセッサ製品グループの副社長兼マイクロプロセッサ部門5/7のジェネラルマネージャである Vinod Dhamは、このRISC技術を既存のx86アーキテクチャに適用して、他の市場と競合するという構想を思いついた。[19]彼らのパフォーマンス目標は、既存のIntel486 CPUと比較して、FPUを3倍と5倍に向上させることだった。[20] 予備設計は1990年に初めてシミュレーションに成功し、続いて設計のレイアウトが行われた。主要なオペレーティングシステムと多くのアプリケーションが起動して実行される、約1億クロックサイクルのプレシリコン検証テストが必要でした。プレシリコンシミュレーションプログラムを実行するために、 Quickturn Systems Inc.のソフトウェアを使用する必要がありましたが、これは以前の技法よりも30,000倍高速でした。[21] 1990年後半までに、計画された機能がダイに収まらないことがわかり、パフォーマンスを犠牲にすることなく意図した設計に収まるようにスリム化されるように回路機能を再設計する必要がありました。 1991年の春、パフォーマンスに影響を与えずにサイズと機能にダムが満足するまで、ダイは再度スリム化されました。エンジニアグループは、設計された機能を検証するために数百のテストを実行し、設計を検証するために5000の異なる変数を実行しました。コレクション内の14の回路基板とケーブルのうち、開発中を含む手元にあるすべてのオペレーティングシステムを使用しても、バグはほんのわずかしか見つかりませんでした。[22] 1992年2月までに設計はテープアウトされ、1992年4月までに完了し、その時点でベータテストが開始されました。[23] [24] 次の数か月で、設計はインテルのマスクオペレーションに送られ、オレゴンのFab 5で処理されるマスクレイアウトに変換されました。[25] 1992年半ばまでに、P5チームのエンジニアは200人になりました。[16] : 89 インテルは当初、1992年6月にPC ExpoトレードショーでP5のデモを行い、1992年9月にプロセッサを正式に発表する予定でしたが、[26]設計上の問題によりデモはキャンセルされ、チップの公式発表は1993年春まで延期されました。[27][28] ペンティアムを搭載した最初のコンピュータシステムは1993年の夏に登場し、最初のものはアドバンストロジックリサーチとそのEvolution Vワークステーションで、1993年7月の第1週にリリースされました。[29] [30] [31]

オリジナルの386の主任設計者ジョン・H・クロフォードは、建築チームを率いたドナルド・アルパートと共にP5の設計を共同で担当した。[ 32]ドロール・アヴノンはFPUの設計を担当した。 [33] ヴィノド・K・ダムはP5グループのゼネラルマネージャーであった。[16] : 90 

インテルのLarrabeeマルチコアアーキテクチャプロジェクトは、P5コア（P54C）から派生したプロセッサコアを使用し、マルチスレッド、64ビット命令、16バイト幅のベクトル処理ユニットが追加されています。[34]初期のAtomプロセッサコアで採用されていたインテルの低消費電力Bonnellマイクロアーキテクチャも、P5と同様のインオーダーデュアルパイプラインを使用しています。[35]

インテルは1991年に「386」の商標をめぐる商標紛争で敗訴したため、586ではなくPentiumという名称を使用しました。この紛争では、裁判官が「386」という数字は一般名義であるとの判決を下しました。同社は、数字ではない新しい名称を考案するために、Lexicon Branding社に依頼しました。[36]

i486からの改良点

P5 マイクロアーキテクチャは、従来の i486 アーキテクチャに比べていくつかの重要な進歩をもたらします。

  • パフォーマンス：
    • スーパースカラ・アーキテクチャ – Pentiumには2つのデータパス（パイプライン）があり、多くの場合、1クロックサイクルあたり2つの命令を実行できます。メインのパイプライン（U）はあらゆる命令を処理でき、もう1つのパイプライン（V）は最も一般的な単純な命令を処理できます。最初の命令はUパイプラインに送られ、次の命令はVパイプラインに送られます。両方のパイプラインには、それぞれ独自のALU、アドレス生成回路、そしてデータキャッシュへのインターフェースが搭載されています。[37]縮小命令セット・コンピュータ（ RISC ）の支持 者の中には、複雑なx86命令セットは、厳密にパイプライン化されたマイクロアーキテクチャではおそらく実装できず、ましてやデュアルパイプライン設計では到底実現できないと主張する者もいました。486とPentiumは、これが実際に可能であり、実現可能であることを実証しました。
    • 64ビットバーストモード外部データバスは、メモリアクセスごとに読み書き可能な情報量を2倍にするため、Pentiumは80486よりも高速にコードキャッシュをロードできます。また、64ビットおよび80ビットのx87 FPUデータへのアクセスと保存も高速化します。このCPUは内部的に32ビット幅でデータを処理します。メモリへの外部データは64ビット幅であるため、1バスサイクルで転送されるデータ量が2倍になります。このCPUには複数の種類のバスサイクルが含まれており、その中には1バスサイクルで256ビット分のデータをデータキャッシュにロードするバーストモードも含まれます。このデータ幅により、メモリとの間で最大528MB/秒のデータ転送が可能です。この速度は、50MHzのIntel486 DX CPUのピーク転送速度の3倍に向上しています。[38]
    • 両方の8Kバイトオンチップキャッシュ[39]でコードとデータを分離することにより、486と比較してフェッチとオペランドの読み書きの競合が軽減されます。1セットは命令用で、もう1セットはデータ用です。[40] アクセス時間と実装コストを削減するために、486の単一の4ウェイキャッシュではなく、両方とも2ウェイアソシアティブです。キャッシュの32バイトラインのペアを使用して、64ビット幅を4チャックバースト長に一致させます。このキャッシュ管理は、MESIキャッシュ一貫性プロトコルに準拠しています。[41] Pentiumの関連する機能強化は、コードキャッシュが2つのキャッシュラインに分割されている場合でも（最悪の場合でも少なくとも17バイト）、コードキャッシュから連続したブロックを読み取ることができることです。
    • はるかに高速な浮動小数点ユニット。このコンポーネントには、クロックサイクルごとに少なくとも1つの浮動小数点演算を実行する8ステージのパイプラインが組み込まれています。このパイプラインの最初の4ステージは整数部分を使用し、最後の4ステージは2ステージの浮動小数点演算実行、丸め、結果のレジスタファイルへの書き込み、およびエラー報告です。このユニットには、これらの共通操作の速度を前世代のCPUよりも3倍向上させる新しいアルゴリズムもあります。[42] 一部の命令、特にFMULでは、80486 FPUよりも最大15倍のスループットを実現し、大幅な改善が見られました。Pentiumは、通常の（算術またはロード/ストア）FPU命令と並列にFXCH ST(x)命令を実行することもできます。
    • 4 入力アドレス加算器により、Pentium は 80486 と比較してアドレス計算のレイテンシをさらに短縮できます。Pentium は、セグメント ベース+ベース レジスタ+スケール レジスタ+イミディエイト オフセットを使用した完全なアドレス指定モードを 1 サイクルで計算できます。486 には 3 入力アドレス加算器しかないため、このような計算を 2 サイクルに分割する必要があります。
    • マイクロコードは両方のパイプラインを使用することで、REP、MOVSWなどの自動繰り返し命令を1クロックサイクルごとに1回の反復処理を実行できます。一方、80486では反復処理ごとに3クロックが必要でした（初期のx86チップでは486よりも大幅に多くのクロックが必要でした）。また、デコード段階における最初のマイクロコードワードへのアクセスの最適化により、特に最も一般的な形式や典型的なケースにおいて、頻繁に実行されるいくつかの命令の実行速度が大幅に向上します。例としては、（486→Pentium、クロックサイクル数）CALL（3→1）、RET（5→2）、シフト/ローテート（2–3→1）などがあります。
    • より高速で、完全にハードウェア ベースの乗算器により、MUL や IMUL などの命令は 80486 よりも数倍高速 (かつ予測可能) になり、実行時間は 32 ビット オペランドの場合は 13 ～ 42 クロック サイクルから 10 ～ 11 クロック サイクルに短縮されます。
    • 仮想 8086 モードを高速化するための仮想化割り込み。
    • 小さなキャッシュブロックを含む分岐ターゲットバッファ方式を用いた動的分岐予測。エラトステネスのふるいベンチマーク法を用いると、Intel486 CPUでは6クロックサイクルかかるのに対し、このCPUでは2クロックサイクルに短縮される。[43]
  • その他の機能:
    • プロセッサ ベースのデバッグ ポートの導入によりデバッグ機能が強化されました (開発者マニュアル Vol 1 の「Pentium プロセッサのデバッグ」を参照)。
    • L1キャッシュパリティチェックなどの強化されたセルフテスト機能（開発者マニュアル第1巻の「キャッシュ構造」を参照）。その他の内蔵機能としては、 CPUへの外部接続をテストするためのIEEE 1149.1準拠のアクセスアーキテクチャや、ソフトウェアが認識できるレジスタとプロセッサ状態にアクセスするためのプローブモードなどがあります。[44]
    • 新しい命令: CPUID、CMPXCHG8B、RDTSC、RDMSR、WRMSR、RSM。
    • テスト レジスタ TR0 ～ TR7 とそれらにアクセスするための MOV 命令は削除されました。
  • 後期のPentium MMXには、マルチメディアアプリケーション向けに開発された基本的なSIMD（整数・単一命令・複数データ）命令セット拡張であるMMX命令セットも追加されました。MMXは、高速なコンテキストスイッチを可能にするためにレジスタが再利用されていたため、 x87 FPU命令と同時に使用することはできませんでした。より重要な機能強化としては、命令キャッシュとデータキャッシュのサイズが倍増したことと、パフォーマンス向上のためのマイクロアーキテクチャへのいくつかの変更が挙げられます。

Pentiumは1億MIPS（1秒あたり1億命令以上）を実行するように設計されており、 [45] 75MHzモデルは特定のベンチマークで126.5MIPSに到達した。[46] Pentiumアーキテクチャは、一般的なベンチマークにおいて、クロックサイクルあたり486プロセッサの2倍弱の性能を示した。最速の80486製品（わずかに改良されたマイクロアーキテクチャと100MHz動作）は、第1世代のPentiumとほぼ同等の性能であり、AMD Am5x86は、その名前にもかかわらず実際には486クラスのCPUであるが、純粋なALU性能に関してはPentium 75とほぼ同等であった。

誤植

60～66MHzのP5 Pentiumの初期バージョンには、浮動小数点演算ユニットに問題があり、一部の除算演算で誤った（しかし予測可能な）結果が出るという問題がありました。この欠陥は1​​994年にバージニア州リンチバーグ大学のトーマス・ナイスリー教授によって発見され、Pentium FDIVバグとして広く知られるようになり、Intelにとって大きな痛手となりました。同社は欠陥プロセッサを交換するための交換プログラムを立ち上げました。

1997年には、悪意のあるプログラムが特別な権限を持たずにシステムをクラッシュさせる可能性がある新たなエラッタ、「F00Fバグ」が発見されました。P5シリーズのすべてのプロセッサが影響を受け、修正版はリリースされませんでしたが、当時のオペレーティングシステムにはクラッシュを防ぐための回避策がパッチとして適用されました。

コアとステッピング

Pentiumは、1990年代半ばのIntelのパーソナルコンピュータ向け主力マイクロプロセッサでした。オリジナルの設計は新しいプロセスで再実装され、競争力を維持し、ポータブルコンピュータなどの特定の市場に対応するために新機能が追加されました。その結果、P5マイクロアーキテクチャには複数のバリエーションが存在しました。

P5

Intel Pentium マイクロアーキテクチャ

最初のPentiumマイクロプロセッサコアのコードネームは「P5」でした。製品コードは80501（初期ステッピングQ0399では80500）でした。ソケット4を使用し、それぞれ60MHzと66MHzで動作するように指定された2つのバージョンがありました。この最初のPentium実装は、273ピンPGAフォームファクタでリリースされ、5V電源で動作しました（通常のトランジスタ-トランジスタロジック（TTL）互換性要件から派生）。310万個のトランジスタを搭載し、16.7mm×17.6mm、面積は293.92mm 2 でした。[47] 800nmの3層メタルバイポーラ相補型金属酸化膜半導体（BiCMOS ）プロセスで製造されました。[48] [49] 5V設計は、直後のモデルと比較して、動作周波数に対して比較的高い消費電力をもたらしました。

P54C

Intel Pentium P54C ダイショット

P5の後継として1994年に登場したP54C (80502)は、3.3ボルト電源で75、90、100MHzで動作するように指定されたバージョンがあった。ソケット5への移行を象徴するこのプロセッサは、3.3ボルトで動作する最初のPentiumプロセッサであり、エネルギー消費は削減されたが、マザーボード上で電圧調整が必要になった。より高クロックの486プロセッサと同様に、ここから内部回路を外部アドレスバスやデータバスよりも高い周波数で動作させるため、内部クロック乗算器が採用された。これは、物理的な制約により外部周波数を上げるのがより複雑で面倒なためである。また、双方向マルチプロセッシングが可能で、統合ローカルAPICと新しい電源管理機能を備えていた。このプロセッサは330万個のトランジスタを内蔵し、面積は163 mm 2であった。[50]これはBiCMOSプロセスで製造されたが、定義の違いにより500nmとも600nmとも呼ばれている。 [50]

P54CQS

P54Cの後継として、1995年初頭に120MHzで動作するP54CQSが登場した。350nm BiCMOSプロセスで製造され、 350nmプロセスで製造された最初の商用マイクロプロセッサとなった。[50]トランジスタ数はP54Cと同一で、より新しいプロセスであるにもかかわらず、ダイ面積も同一であった。チップはワイヤボンディングを用いてパッケージに接続されていたが、ワイヤボンディングではチップのエッジに沿った接続しかできなかった。チップを小型化するには、ワイヤの長さに制限があり、チップのエッジがパッケージ上のパッドから遠ざかるため、パッケージの再設計が必要だった。解決策は、チップのサイズをそのままに、既存のパッドリングを維持し、Pentiumのロジック回路のみを縮小することで、より高いクロック周波数を実現することだった。[50]

P54CS

P54CQSの後継として、133、150、166、200MHzで動作するP54CSが登場し、Socket 7を導入しました。330万個のトランジスタを搭載し、面積は90mm² 、 4層の相互接続を備えた350nm BiCMOSプロセスで製造されました。

P24T

486システム向けのP24T Pentium OverDriveは1995年にリリースされました。これは3.3V 600nmバージョンをベースにしており、63MHzまたは83MHzのクロック周波数を採用していました。Socket 2 / 3を採用していたため、486マザーボードの32ビットデータバスと低速なオンボードL2キャッシュを補うために、いくつかの変更が必要でした。そのため、32KBの L1キャッシュ（P55C以前のPentium CPUの2倍）が搭載されました。

P55C

Intel Pentium MMX マイクロアーキテクチャ
Pentium MMX 166 MHz（カバーなし）

P55C（または80503）は、イスラエルのハイファにあるインテル研究開発センターで開発されました。Pentium with MMX Technology（通常はPentium MMXと呼ばれます）として販売されました。P5コアをベースとしていましたが、デジタルメディアデータのエンコードやデコードといったマルチメディアタスクのパフォーマンス向上を目的とした、57個の新しい「MMX」命令セットを搭載していました。Pentium MMXシリーズは1996年10月22日に発表され、1997年1月に発売されました。[51]

新しい命令は、新しいデータ型、すなわち8ビット整数8個、16ビット整数4個、32ビット整数2個、または64ビット整数1個からなる64ビットパックベクターで動作します。例えば、PADDUSB（Packed ADD Unsigned Saturated Byte）命令は、8ビット符号なし整数8個を含む2つのベクターを要素ごとに加算します。オーバーフローする加算は飽和 し、1バイトで表現できる最大の符号なし値である255が生成されます。これらの特殊な命令を使用するには、通常、プログラマによる特別なコーディングが必要です。[要出典]

コアの他の変更点としては、リターンスタック（Cyrix 6x86で初めて採用）と並列性の向上による6段パイプライン（P5では5段）、改良された命令デコーダ、4ウェイ連想性を備えた16KB L1データキャッシュ + 16KB L1命令キャッシュ（P5では2ウェイの8KB L1データ/命令）、どちらのパイプラインでも使用できる4つの書き込みバッファ（P5では各パイプラインに1つずつ対応）、およびPentium Proから引き継いだ512エントリバッファ（P5では256エントリ）を備えた改良された分岐予測器などがあります。[52] [53 ]

このチップは450万個のトランジスタを搭載し、面積は140 mm 2でした。280 nm CMOSプロセスで製造され、従来の350 nm BiCMOSプロセスと同じ金属ピッチを採用していたため、Intelはトランジスタ密度が近いことから「350 nm」と表現しました。[55]このプロセスは4層の相互接続を備えています。[55]

P55CはSocket 7との互換性を維持していましたが、チップへの電源供給に必要な電圧要件は標準のSocket 7仕様とは異なります。P55C規格が制定される前に製造されたSocket 7対応のマザーボードのほとんどは、このCPUの正常な動作に必要なデュアル電圧レール（コア電圧2.8ボルト、入出力（I/O）電圧3.3ボルト）に準拠していません。Intelは、独自の電圧調整機能を備えたインターポーザーを搭載したOverDriveアップグレードキットでこの問題に対処しました。

ティラムック

Pentium MMXノートブックCPUは、CPUを内蔵するモバイルモジュールを採用していました。このモジュールは、CPUが直接接続されたプリント基板（PCB）で、小型フォームファクタに収められていました。このモジュールはノートブックのマザーボードにスナップ留めされ、通常はヒートスプレッダが取り付けられてモジュールと接触していました。しかし、250nmプロセス技術を採用したTillamook Mobile Pentium MMX（オレゴン州の都市にちなんで命名）では、このモジュールに430TXチップセットとシステムの512KBのスタティックランダムアクセスメモリ（SRAM）キャッシュメモリも搭載されていました。

モデルとバリエーション

Pentium および MMX テクノロジー搭載 Pentium
コードネームP5P54CP54C/P54CQSP54CSP55Cティラムック
製品コード805018050280503
プロセスサイズ800 nm600 nmまたは350 nm*350 nm350 nm（後に280 nm）250 nm
ダイ面積（mm 2）293.92 (16.7 x 17.6 mm)148 @ 600 nm / 91 (後に 83) @ 350 nm91（後に83）141 @ 350 nm / 128 @ 280 nm94.47 (9.06272 x 10.42416 mm)
トランジスタ数（百万）3.103.203.304.50
ソケットソケット4ソケット5/7ソケット7
パッケージCPGA /CPGA+IHSCPGA/CPGA+IHS/ TCP *CPGA/TCP*CPGA/TCP*CPGA/ PPGAPPGATCP*CPGA/PPGA/TCP*PPGA/TCP*MMC-1上のTCP/TCP
クロック速度（MHz）60667590100120133150166200120*133*150*166200233166200233266300
バス速度（MHz）6066506050666066606660666066
レベル1キャッシュサイズ8 KB 2ウェイセットアソシアティブコードキャッシュ。8 KB 2ウェイセットアソシアティブライトバックデータキャッシュ16 KB 4ウェイセットアソシアティブコードキャッシュ。16 KB 4ウェイセットアソシアティブライトバックデータキャッシュ
コア電圧5.05.153.3 2.9*3.3 2.9*3.3 3.1* 2.9*3.3 3.1* 2.9*3.3 3.1* 2.9*3.3 3.1* 2.9*3.33.32.2*2.45*2.45*2.8 2.45*2.82.81.9 1.8*1.8*1.9 1.8*1.9 2.0*2.0*
I/O電圧5.05.153.33.33.33.33.33.33.33.33.33.33.33.33.33.32.52.52.52.52.5
TDP（最大W）14.6 (15.3)16.0 (17.3)8.0 (9.5) 6.0* (7.3*)9.0 (10.6) 7.3* (8.8*)10.1 (11.7) 600nmで8.0* (600nmで9.8*) 350nmで5.9* (350nmで7.6*)12.8 (13.4) 7.1* (8.8*)11.2 (12.2) 7.9* (9.8*)11.6 (13.9) 10.0* (12.0*)14.5 (15.3)15.5 (16.6)4.2*7.8* (11.8*)8.6* (12.7*)13.1 (15.7) 9.0* (13.7*)15.7 (18.9)17.0 (21.5)4.5 (7.4) 4.1* (5.4*)5.0* (6.1*)5.5* (7.0*)7.6 (9.2) 7.6* (9.6*)8.0*
紹介された1993年3月22日1994年10月10日1994年3月7日1995年3月27日1995年6月12日1996年1月4日1996年6月10日1996年10月20日1997年5月19日1997年1月8日1997年6月2日1997-081998-011999-01
* アスタリスクは、これらがラップトップ用のモバイル Pentium またはモバイル Pentium MMX チップとしてのみ利用可能であったことを示します。
MMX テクノロジー搭載 Pentium OverDrive
コードネームP54CTB
製品コードポッドMT60X150PODPMT66X166ポッドMT60X180ポッドピーエムティー66X200
プロセスサイズ（nm）350
ソケットソケット5/7
パッケージヒートシンク、ファン、電圧レギュレータを備えたCPGA
クロック速度（MHz）125150166150180200
バス速度（MHz）506066506066
アップグレードペンティアム75ペンティアム90Pentium 100および133ペンティアム75ペンティアム90、120、150ペンティアム100、133、166
TDP（最大W）15.615.615.618
電圧3.33.33.33.3
MMXテクノロジ搭載Pentiumの組み込みバージョン
コードネームP55Cティラムック
製品コードFV8050366200FV8050366233FV80503CSM66166GC80503CSM66166GC80503CS166EXTFV80503CSM66266GC80503CSM66266
プロセスサイズ（nm）350250
クロック速度（MHz）200233166166166266266
バス速度（MHz）66666666666666
パッケージPPGAPPGAPPGABGABGAPPGABGA
TDP（最大W）15.7174.54.14.17.67.6
電圧2.82.81.91.81.81.92.0

競合他社

Pentiumの発表後、NexGen、[56] AMD、Cyrix、Texas Instrumentsなどの競合他社が1994年にPentium互換プロセッサを発表しました。 [57] CIO誌はNexGenのNx586を最初のPentium互換CPUと評し、[58] PC MagazineはCyrix 6x86を最初のPentium互換CPUと評しました。これに続いてAMD K5が発表されましたが、設計上の困難さから発売が遅れました。AMDは後にNexGenを買収してAMD K6の設計を支援し、CyrixはNational Semiconductorに買収されました。[59]その後のAMDとIntelのプロセッサは、オリジナルのPentiumとの互換性を維持しています。

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参照

参考文献

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  • CPU-Collection.de - Intel Pentium の画像と説明
  • Plasma Online Intel CPU 識別
  • Pentiumタイムライン・プロジェクトは、2021年12月23日にWayback Machineにアーカイブされました。Pentiumタイムライン・プロジェクトは、製造されたすべてのS-Specチップの中で、最も古いチップと最も新しいチップをマッピングします。データはインタラクティブなタイムラインに表示されます。

Intelのデータシート

  • ペンティアム（P5）
  • ペンティアム（P54）
  • ペンティアムMMX（P55C）
  • モバイルペンティアムMMX（P55C）
  • モバイル Pentium MMX (ティラムック)

Intelのマニュアル

これらの公式マニュアルでは、Pentium プロセッサとその機能の概要について説明します。

  • Pentium プロセッサ ファミリ デベロッパーズ マニュアル Pentium プロセッサ (第 1 巻) (Intel 注文番号 241428)
  • Pentium プロセッサ ファミリ デベロッパーズ マニュアル 第 2 巻: 命令セット リファレンス (Intel 注文番号 243191)
  • Pentium プロセッサ ファミリ デベロッパーズ マニュアル 第 3 巻: アーキテクチャおよびプログラミング マニュアル[リンク切れ] (Intel 注文番号 241430)
先行ペンティアム（オリジナル）
1993–1999		後継者
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